當你信心滿滿的解釋完fifo原理和RTL coding後

老闆們總是喜歡嘗試擊破那個有自信的你

地獄般的題組考驗這就來了

fifo觀念解釋的很棒, rtl coding也沒問題

那靠gray code就能保證post silicon不會有問題了嗎?

如果chip回來發現fifo的read 

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地獄

預防

[Verilog] 再次征戰FIFO地獄 - (7) fifo constraint



準備實作Async Fifo時,

我習慣將整個架構切成4塊來實作,

讓coding實的思緒比較有條理一點.

Block 0 : 整體的interface

Block 1 : mem周邊

Block 2 : Gray code pointer control

Block 3 : wri

音樂藝文

[Verilog] 再次征戰FIFO地獄 - (6) async fifo rtl coding



回到這張看起來很複雜的AFIFO架構圖 (*藍色訊號為write clk  *紅色訊號為read clk)

我們開始來專心探討一下圖中B2G這區塊的功用

相信各位看懂架構後coding就不是甚麼大問題

回顧一下,

我們先思考ptr在傳輸時沒有處理CDC issue時會發生甚麼事?

pt

有機

限制

[Verilog] 再次征戰FIFO地獄 - (5) async fifo

這題的題目在這裡:Gray Code

題目敘述

題目會給我們一個bit寬度n，要求我們造出所有格雷編碼。

格雷編碼就是一組二進位編碼，每兩個相鄰的編碼的hamming distance都是1。

如果第一次接觸的讀者，可以參考 Wiki Gray Code



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graycode