數位IC設計
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面試必考題, 人人說的一口好setup time / hold time
但是除了公式外很沒有感覺,
小弟出一張嘴經年累月用心體會說說對這個timing設定的感想,
講一下我消化完對他的定義
setup time 指的是當訊號要被抓住前必須保持穩定幾秒
hold time 指的是當訊號被
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數位IC裡我們關注的都是0或1,
大家都知道電腦是0101在做二進位的運算,
在晶片裡又是怎麼做到的?
實際上我們在設計晶片時,會給他一個VDD跟GND,
VDD-GND給的是預期的Driving volatge,
像是5V或9V
以5V為例
0或1物理上就是目前的電壓靠近0V或5
IC設計流程大致如下
每個步驟都是必經過程,走完整個過程後輸出一版real chip
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| 定SPEC | --- 決定 Function/clk period/製程liberary .